互联系。下面分别介绍各模块实现的功能。(限于篇幅，仅给出采集同步模块的程序。)
（1）Set_sample.vhd采集同步模块
它是图像采集部分的一个块语句，输入输出信号为：
pcicon0-IN，启动采集图像信号；
vref-IN，场参考信号；
rts0-IN,奇偶场标志信号；
sig_frame-OUT，采集同步输出信号，高电平有效，用于图像采集和总线管理模块；
sig_field-OUT，采集同步场参考信号，采集1帧图像的场参考信号。
源程序如下：
set_sample:block
signal flagct:std_logic_vector(2 downto 0）；
begin
process(pcicon0,vref)
begin
if(pcicon0='O')then
flagct<="01";
elsif(vref 'event and vref='J')then
if(flagct="001"and rts0='1')then
flagct<="010";
elsif(flagct="010")then
flagct<="011";
elsif(flagct="011")then
flagct<="100";
end if;
end if;
end process;
process(flagct)
begin
if(flagct="010" or flagct="011")then
sig_frame<='1';
else
sig_frame<='0';
end if;
end process;
sig_field<=sig_frame and vref;
end block；
当pcicon0引脚再现大于等于场周期(20ms)的低电平信号时，可以确保该模块处于触发状态，在下一个奇数场出现时，(rts0=1)，根据SAA7111的场参考信号产生具有两场时宽的采集同步信号（sig_frame）。该信号有效时为图像采集阶段，对SRAM1写入数据；该信号撤消时采集同步模块自动复位，等待下一次采集命令，同时FPGA1开始读取SRAM1中数据进行处理。采集同步信号有效的同时输出采集同步场参考信号，用于采集图像数据。
(2)Delay.vhd延时模块
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